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MT48LC16M16A2TG-75IT +BOM

Synchronous DRAM, 16MX16, 5.4ns, CMOS, PDSO54

Caratteristiche principali

PC66-, PC100-, and PC133-compliant

Fully synchronous; all signals registered on positive edge of system clock

Internal pipelined operation; column address can be changed every clock cycle

Internal banks for hiding row access/precharge

Programmable burst lengths: 1, 2, 4, 8, or full page

Auto Precharge, includes CONCURRENT AUTO PRECHARGE, and Auto Refresh Modes

Self Refresh Mode

64ms, 8,192-cycle refresh

LVTTL-compatible inputs and outputs

Single +3.3V 0.3V power supply

Specifiche

Product Category Memory ICs

Politiche di servizio e altro

Relativi al servizio post-vendita e alla liquidazione

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